CVE-2026-98546
En el kernel de Linux se ha resuelto la siguiente vulnerabilidad:
arm64/boot: Deshabilitar la interceptación de las escrituras de PMZR_EL0 a EL2
__init_el2_fgt2() escribe una misma máscara tanto en HDFGRTR2_EL2 como en HDFGWTR2_EL2. PMZR_EL0 es de solo escritura, por lo que su bit de interceptación, nPMZR_EL0, existe únicamente en HDFGWTR2_EL2 y, por tanto, nunca se establece: una escritura en PMZR_EL0 desde el host se intercepta y pasa a EL2, donde el hipervisor nVHE no tiene manejador y ejecuta BUG().
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El kernel nunca escribe en PMZR_EL0, pero kernel.perf_user_access=1 hace que el controlador de la PMU establezca PMUSERENR_EL0.UEN para una tarea con un evento de lectura de usuario, de modo que una escritura desde EL0 llega a la interceptación y tumba el host sin mensaje de pánico.
Acumular los bits de HDFGWTR2_EL2 por separado, como ya hace __init_el2_fgt() con HDFGWTR_EL2, y establecer nPMZR_EL0 junto con los demás bits de FEAT_PMUv3p9.
Traducción automática del texto original de NVD (en inglés).
CVSS
NVD no ha asignado puntuación CVSS a esta CVE (habitual desde el cambio de política de abril de 2026).
Probabilidad de explotación (EPSS)
- Probabilidad de explotación en los próximos 30 días
- 0.20 %
- Percentil entre todas las CVEs puntuadas
- 9
- Fecha de la puntuación
- 20/10/2026
EPSS (Exploit Prediction Scoring System, de FIRST) estima la probabilidad de que una vulnerabilidad sea explotada en 30 días. Complementa a CVSS (impacto) y a CISA KEV (explotación confirmada).
Tecnologías afectadas (1)
⚠ Inferidas por IA a partir de la descripción — NVD aún no ha analizado esta CVE; no son CPE verificados.
Referencias
Mostrar las 4 referencias
JSON original (NVD)
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"published": "2026-10-18T16:17:06.517",
"references": [
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"vulnStatus": "Received",
"descriptions": [
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"lang": "en",
"value": "In the Linux kernel, the following vulnerability has been resolved:\n\narm64/boot: Disable trapping of PMZR_EL0 writes to EL2\n\n__init_el2_fgt2() writes one mask to both HDFGRTR2_EL2 and HDFGWTR2_EL2.\nPMZR_EL0 is write-only, so its trap bit, nPMZR_EL0, exists only in\nHDFGWTR2_EL2 and is therefore never set: a PMZR_EL0 write from the host\ntraps to EL2, where the nVHE hypervisor has no handler and BUG()s. The\nkernel never writes PMZR_EL0, but kernel.perf_user_access=1 has the PMU\ndriver set PMUSERENR_EL0.UEN for a task with a user-read event, so a\nwrite from EL0 reaches the trap and takes the host down without a panic\nmessage.\n\nAccumulate the HDFGWTR2_EL2 bits separately, as __init_el2_fgt() already\ndoes for HDFGWTR_EL2, and set nPMZR_EL0 with the other FEAT_PMUv3p9\nbits."
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"lastModified": "2026-10-19T10:19:10.600",
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